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在AMD首发PCIe 4.0后，Inte编程客栈l去年紧接着开始普及PCIe 5.0。

虽然PCLrOEsgFKWeIe 6.0规范今年初编程客栈才刚刚对外公布，标准组织PCI SIG今天正式宣布开发PCIe 7.0，并前瞻了核心参数。

和这几代的变化类似，PCIe 7.0在PCIe 6.0的基础上再次实现带宽翻翻，达到128GT/s，x16通道双向可以达到512GB/s。

即便是SSD常走的x2/x4通道，理论峰值速度也分别提高到64GB/s和128GLrOEsgFKWeB/s，想象空间无限大。

细节方面，PCIe 7.0和6.0一样，采用全新的PAM4调制，1b/1b编码。值得一提的是，PCIe 7.0依然保持了向下兼容。

PCI SIG组织称，接下来的草案中会着重优化信道参数，并提高能效水平。

按计划，PCIe 7.0标准正本会在2025年完工，外界认为全面普及恐怕要到编程客栈2028年左右了。